| Mode | Name | Size | |
|---|---|---|---|
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| -rw-r--r-- | BulkConnect.fir | 1059 | logplain |
| -rw-r--r-- | DeadCodeElimination.fir | 210 | logplain |
| -rw-r--r-- | EmptyStmt.fir | 207 | logplain |
| -rw-r--r-- | ExModule.fir | 310 | logplain |
| -rw-r--r-- | InitAccessor.fir | 305 | logplain |
| -rw-r--r-- | InitializeVec.fir | 694 | logplain |
| -rw-r--r-- | Link.fir | 313 | logplain |
| -rw-r--r-- | Long.fir | 168 | logplain |
| -rw-r--r-- | MemSize1.fir | 259 | logplain |
| -rw-r--r-- | NestedAccess.fir | 853 | logplain |
| -rw-r--r-- | Poison.fir | 940 | logplain |
| -rw-r--r-- | Printf.fir | 638 | logplain |
| -rw-r--r-- | Queue.fir | 285 | logplain |
| -rw-r--r-- | SeqMem.fir | 988 | logplain |
| -rw-r--r-- | Stop.fir | 435 | logplain |
| -rw-r--r-- | TwoClocks.fir | 504 | logplain |
| -rw-r--r-- | VerilogReg.fir | 380 | logplain |
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