passes « firrtl « scala « main « src - sfcX - Scala FIRRTL Compiler for chiselX

Mode	Name	Size
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-rw-r--r--	CheckInitialization.scala	3093	log plain
-rw-r--r--	CheckWidths.scala	5194	log plain
-rw-r--r--	Checks.scala	27147	log plain
-rw-r--r--	CommonSubexpressionElimination.scala	1354	log plain
-rw-r--r--	ConvertFixedToSInt.scala	5385	log plain
-rw-r--r--	DeadCodeElimination.scala	1830	log plain
-rw-r--r--	ExpandWhens.scala	10508	log plain
-rw-r--r--	InferTypes.scala	4527	log plain
-rw-r--r--	InferWidths.scala	14120	log plain
-rw-r--r--	Inline.scala	6422	log plain
-rw-r--r--	LowerTypes.scala	12144	log plain
-rw-r--r--	PadWidths.scala	2396	log plain
-rw-r--r--	Passes.scala	14442	log plain
-rw-r--r--	RemoveAccesses.scala	6239	log plain
-rw-r--r--	RemoveCHIRRTL.scala	11445	log plain
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-rw-r--r--	RemoveValidIf.scala	1790	log plain
-rw-r--r--	ReplaceAccesses.scala	778	log plain
-rw-r--r--	Resolves.scala	5013	log plain
-rw-r--r--	SplitExpressions.scala	1920	log plain
-rw-r--r--	Uniquify.scala	14311	log plain
-rw-r--r--	VerilogModulusCleanup.scala	2542	log plain
-rw-r--r--	ZeroWidth.scala	3970	log plain
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d---------	memlib	635	log plain
d---------	wiring	134	log plain