passes « firrtl « scala « main « src - sfcX - Scala FIRRTL Compiler for chiselX

Mode	Name	Size
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-rw-r--r--	CheckInitialization.scala	3045	log plain
-rw-r--r--	CheckWidths.scala	6054	log plain
-rw-r--r--	Checks.scala	31379	log plain
-rw-r--r--	CommonSubexpressionElimination.scala	1306	log plain
-rw-r--r--	ConvertFixedToSInt.scala	5378	log plain
-rw-r--r--	DeadCodeElimination.scala	1808	log plain
-rw-r--r--	ExpandWhens.scala	12011	log plain
-rw-r--r--	InferTypes.scala	4495	log plain
-rw-r--r--	InferWidths.scala	17287	log plain
-rw-r--r--	Inline.scala	11577	log plain
-rw-r--r--	LowerTypes.scala	12088	log plain
-rw-r--r--	PadWidths.scala	2240	log plain
-rw-r--r--	Passes.scala	13045	log plain
-rw-r--r--	RemoveAccesses.scala	6420	log plain
-rw-r--r--	RemoveCHIRRTL.scala	11589	log plain
-rw-r--r--	RemoveEmpty.scala	394	log plain
-rw-r--r--	RemoveValidIf.scala	1774	log plain
-rw-r--r--	ReplaceAccesses.scala	649	log plain
-rw-r--r--	Resolves.scala	5013	log plain
-rw-r--r--	SplitExpressions.scala	1920	log plain
-rw-r--r--	Uniquify.scala	14828	log plain
-rw-r--r--	VerilogModulusCleanup.scala	2542	log plain
-rw-r--r--	VerilogRename.scala	447	log plain
-rw-r--r--	ZeroWidth.scala	6738	log plain
d---------	clocklist	195	log plain
d---------	memlib	723	log plain
d---------	wiring	134	log plain